ADCLK905调试

ADCLK905采用的单端转差分模式，输入时钟信号正常，经过电容C61后变成一个高电平。
去掉C61后直接短路，1脚输入正常，但是输出的11，12脚都是高电平。2脚测量为低电平。

实际上经过电容C61后不是一个电高平，只是时钟叠加到一个直流（应该是VREF电压）上面了。
输出没有时钟问题是出在输出没有直流通路。不能直接接到ADC的时钟端，应该按照下图接匹配电路。

只接了R32还是不对，必须加上C35，时钟输出才正常。
最后电路是这样的

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