Xilinx 差分信号 LVDS传输实战
目录
1.LVDS的概念
2.XILINX FPGA 差分信号解决方案
(1)IBUFDS
(2)OBUFDS
(3)IOBUFDS(三态差分输入输出)
3.LVDS中的终端电阻
4.LVDS 电气特性
(1)LVDS25
(2)LVDS25
5.LVDS 自环测试
1.LVDS的概念
2.XILINX FPGA 差分信号解决方案
(1)IBUFDS
(2)OBUFDS
(3)IOBUFDS(三态差分输入输出)
3.LVDS中的终端电阻
注:如果要使用内部的终端电阻,对于 HP 的 LVDS 信号 BANK 电压必须是 1.8V,而对于 HR 的 LVDS25 BANK 信号必须是 2.5V,否则可以使用外部终端电阻。
4.LVDS 电气特性
(1)LVDS25
(2)LVDS25
5.LVDS 自环测试
module lvds_loop(// sysclk input 系统时钟input clk_i_p ,input clk_i_n ,// TTL输入输出input rx_i ,output tx_o ,//lvds loop input 输入的LVDS时钟input dclki_p ,input dclki_n ,input din_p ,input din_n ,//lvds loop output 输出的LVDS时钟output dclko_p ,output dclko_n ,output dout_p ,output dout_n
);wire clk50m,dclki,din;
reg rx_lvds = 1'b0;wire clk_i;// 得到单端系统时钟,对差分时钟采用 IBUFGDS IP 核去转换
IBUFGDS CLK_U(.I ( clk_i_p ),.IB ( clk_i_n ),.O ( clk_i )
);//clk_wiz_0 uclk(.clk_out1(clk50m),.clk_out2(clk5m), .clk_in1_p(clk_i_p),.clk_in1_n(clk_i_n));
clk_wiz_0 uclk(.clk_out1(clk50m),.clk_in1(clk_i));// lvds out, 把 rx 接收到的数据,通过LVDS发送出去
// 输出50M的差分时钟
OBUFDS #(.IOSTANDARD ( "DEFAULT" ), // Specify the output I/O standard.SLEW ( "SLOW" )
)
dclko_OBUFDS
(.O ( dclko_p ),.OB ( dclko_n ),.I ( clk50m )
);// 输出接收到的数据
OBUFDS #(.IOSTANDARD ( "DEFAULT" ), // Specify the output I/O standard.SLEW ( "SLOW" )
)
dout_OBUFDS
(.O ( dout_p ),.OB ( dout_n ),.I ( rx_i )
);//lvds in
// 还原单端时钟
IBUFDS
#(.DIFF_TERM ( "TRUE" ), // Differential Termination.IBUF_LOW_PWR ( "TRUE" ), // Low power="TRUE", Highest performance="FALSE" .IOSTANDARD ( "DEFAULT" ) // Specify the input I/O standard
)
dclki_IBUFDS
(.O ( dclki ), // 1-bit output: Buffer output.I ( dclki_p ), // 1-bit input: Diff_p buffer input (connect directly to top-level port).IB ( dclki_n ) // 1-bit input: Diff_n buffer input (connect directly to top-level port)
);
// 还原单端数据
IBUFDS
#(.DIFF_TERM ( "TRUE" ), // Differential Termination.IBUF_LOW_PWR ( "TRUE" ), // Low power="TRUE", Highest performance="FALSE" .IOSTANDARD ( "DEFAULT" ) // Specify the input I/O standard
)
ddatai_IBUFDS
(.O ( din ), // 1-bit output: Buffer output.I ( din_p ), // 1-bit input: Diff_p buffer input (connect directly to top-level port).IB ( din_n ) // 1-bit input: Diff_n buffer input (connect directly to top-level port)
); always @(posedge dclki)beginrx_lvds <= din;
endassign tx_o = rx_lvds;endmodule
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