Verilog 习题笔记_实例化模块多路复用器

习题来源：https://hdlbits.01xz.net/wiki/Main_Page

习题要求：实例化三个my_dff8模块，然后将它们链接在一起，形成一个长度为3的8位宽移位寄存器，在此基础上实现一个4:1多路复用器，根据触发器的取值来选择要输出的内容。

习题分析：

1、需要注意三条8位矢量线，这里可以定义三个wire变量；

2、多路复用器可以用case函数来实现；

3、注意位宽；

module top_module ( input clk,input [7:0] d,output [7:0] q
);wire [7:0] q1,q2,q3;/*实例化三个my_dff8模块*/my_dff8 my_dff8_1 ( .q(q1), .clk(clk), .d(d) );my_dff8 my_dff8_2 ( .q(q2), .clk(clk), .d(q1));my_dff8 my_dff8_3 ( .q(q3), .clk(clk), .d(q2));/*实现多路复用寄存器*/always @(*) begincase (sel)1'd0 : q = d  ;1'd1 : q = q1;1'd2 : q = q2;1'd3 : q = q3;endcaseendendmodule

编译结果：

结果分析： sel为0、1、2、3时，d分别输出对应d、q1、q2、q3的值；

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