12.3明德杨UART_TX调试经验

根据明德杨的学习资料，一步一步敲写UART_TX代码。发现以下问题

总结如下：

12.2晚上代码写完后，仿真波形出不来，12.3早上通过查看波形，定位到flag不能变成高电平，计数器就无法工作，tx_begin是时序逻辑flag变成1的条件。

always @(posedge clk or negedge rst_n) begin

if (rst_n == 1'b0) begin

// reset

flag <= 0;

end

else if (tx_begin) begin

flag <= 1;

end

else if (end_cnt2) begin

flag <= 0;

end

assign tx_begin = tx_vld && !flag ;

tx_begin是组合逻辑，结果发现，tx_vld和clk，对齐了，导致tx_begin和clk也对齐了，下一个时钟上升沿，flag信号就变化不了，或者无法判断tx_begin到底是低电平或者高电平。所以flag不能变成高电平。

所以对输入端口tx_vld波形有要求，要么波形长度大于一个时钟周期，要么不要和clk对齐。

改完波形如下：

改完后波形能够正常输出，但是自己观察tx_begin，末端还是和clk上升沿对齐，但是flag还是能正常变成1，目前自己能力，只考虑到后仿真，或者时序不能对齐时，可能还是会对flag跳转为1有影响，修改tx_begin组合逻辑

assign tx_begin = tx_vld && !tx_rdy ;

修改完后，波形如下：

可以看到，tx_begin长度和tx_vld一致了，后面自己还是有疑问，这样tx_begin信号波形和tx_vld信号波形是一样的，岂不是多此一举。

想到flag是计数器开始标志，这会对整个计数开始时间

计算十个数据传输时间：

仿真波形显示也是1.0416ms。

目前考虑到的就这么多

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