systemverilog 宏定义 `define 用法。

#将宏定义转化成字符串
`define stringfy(x) `"x`"
string s;
s = `stringfy(`macro);#此时宏`macor不可以有输入，否则报错。

更多内容参考： SystemVerilog Macros

有一点特别注意的是：宏定义后面要紧跟“()”,中间不能有空格，否则编译器报错，并且不会明确告诉你错误在哪里！！！

示例：sv 的宏 - hippomyl - 博客园

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