zedboard板子上呼吸灯的实现（第一版）

这是原始代码时钟信号为50MHz

module breathe_led(input clk,      // 时钟信号input rst,     // 复位信号output led);// reg definereg [15:0] period_cnt; // 周期计数器 1khz = 1ms 1_000_000ns / 20ns(50mhz) = 50_000(16位二进制)reg [15:0] duty_cycle; // 设置高电平占空比的计数点reg inc_dec_flag;   // 用于表示高电平占空比的计数值，是递增还是递减// 为1时表示占空比递减，为0时表示占空比递增// 将周期信号计数值与占空比计数值进行比较，以输出驱动led的PWM信号assign led = (period_cnt <= duty_cycle) ? 1'b1 : 1'b0;// 周期信号计数器在0-50_000之间计数always @(posedge clk or posedge rst) beginif(rst)period_cnt <= 16'd0;else if(period_cnt == 16'd50_000)period_cnt <= 16'd0;elseperiod_cnt <= period_cnt + 16'd1;end// 设置高电平占空比的数always @(posedge clk or negedge rst) beginif(rst == 1'b1) beginduty_cycle <= 16'd0;inc_dec_flag <= 1'b0;end// 每次计数完一个周期，就调节占空比计数值else if(period_cnt == 16'd50_000) beginif(inc_dec_flag) begin // 为1占空比递减if(duty_cycle == 16'd0)inc_dec_flag <= 1'b0;else duty_cycle <= duty_cycle - 16'd25;endelse begin // 占空比递增if(duty_cycle == 16'd50_000)inc_dec_flag <= 1'b1;elseduty_cycle <= duty_cycle + 16'd25;endendelse // 未计数完一个周期，占空比保持不变duty_cycle <= duty_cycle;end
endmodule

管脚约束文件

set_property IOSTANDARD LVCMOS33 [get_ports led]
set_property PACKAGE_PIN U14 [get_ports led]set_property IOSTANDARD LVCMOS33 [get_ports rst]
set_property PACKAGE_PIN P16 [get_ports rst]set_property IOSTANDARD LVCMOS33 [get_ports clk]
set_property PACKAGE_PIN Y9 [get_ports clk]

修改为时钟信号为100MHz，可以看到视频里呼吸灯变慢了

module breathe_led(input clk,      // 时钟信号input rst,     // 复位信号output led);// reg definereg [16:0] period_cnt; // 周期计数器 1khz = 1ms 1_000_000ns / 10ns(100mhz) = 100_000(17位二进制)reg [16:0] duty_cycle; // 设置高电平占空比的计数点reg inc_dec_flag;   // 用于表示高电平占空比的计数值，是递增还是递减// 为1时表示占空比递减，为0时表示占空比递增// 将周期信号计数值与占空比计数值进行比较，以输出驱动led的PWM信号assign led = (period_cnt <= duty_cycle) ? 1'b1 : 1'b0;// 周期信号计数器在0-100_000之间计数always @(posedge clk or posedge rst) beginif(rst)period_cnt <= 17'd0;else if(period_cnt == 17'd100_000)period_cnt <= 17'd0;elseperiod_cnt <= period_cnt + 17'd1;end// 设置高电平占空比的数always @(posedge clk or negedge rst) beginif(rst == 1'b1) beginduty_cycle <= 17'd0;inc_dec_flag <= 1'b0;end// 每次计数完一个周期，就调节占空比计数值else if(period_cnt == 17'd100_000) beginif(inc_dec_flag) begin // 为1占空比递减if(duty_cycle == 17'd0)inc_dec_flag <= 1'b0;else duty_cycle <= duty_cycle - 17'd25;endelse begin // 占空比递增if(duty_cycle == 17'd100_000)inc_dec_flag <= 1'b1;elseduty_cycle <= duty_cycle + 17'd25;endendelse // 未计数完一个周期，占空比保持不变duty_cycle <= duty_cycle;end
endmodule

位宽17位，定义为[16:0]

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