XDC文件注释必须要另起一行

请谨记标题，这个标题可以帮你减少一个星期的调试时间；

起因

工程更新，需要增加相关功能引脚；

为了方便，就将已经弄好的FPGA引脚与Schematic中net的连接关系，复制在xdc文件中；

想着为了后面检擦方便，就直接将net注释在了每一行的引脚约束后面，就像下面这样：

set_property PACKAGE_PIN AD23     [get_ports VIDEO_CLK]      # [get_ports LPC2_CLK0_M2C_P

就像这样，把所有的新加上信号进行了这样的约束；

问题来了

分析通过

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